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Virtex-6 FPGA Data Sheet: DC and Switching Characteristics
LVPECL DC Specifications (LVPECL_25)
These values are valid when driving a 100 Ω differential load only, i.e., a 100 Ω resistor between the two receiver pins. The
V OH levels are 200 mV below standard LVPECL levels and are compatible with devices tolerant of lower common-mode
ranges. Table 11 summarizes the DC output specifications of LVPECL. For more information on using LVPECL , see UG361 :
Virtex-6 FPGA SelectIO Resources User Guide .
Table 11: LVPECL DC Specifications
Symbol
V OH
V OL
V ICM
DC Parameter
Output High Voltage
Output Low Voltage
Input Common-Mode Voltage
Min
V CC – 1.025
V CC – 1.81
0.6
Typ
1.545
0.795
–
Max
V CC – 0.88
V CC – 1.62
2.2
Units
V
V
V
V IDIFF
Differential Input
Voltage (1)(2)
0.100
–
1.5
V
Notes:
1.
2.
Recommended input maximum voltage not to exceed V CCAUX + 0.2V.
Recommended input minimum voltage not to go below –0.5V.
eFUSE Read Endurance
Table 12 lists the maximum number of read cycle operations expected. For more information, see UG360 : Virtex-6 FPGA
Configuration User Guide .
Table 12: eFUSE Read Endurance
Symbol
DNA_CYCLES
AES_CYCLES
Description
Number of DNA_PORT READ operations or JTAG ISC_DNA read
command operations. Unaffected by SHIFT operations.
Number of JTAG FUSE_KEY or FUSE_CNTL read command
-3
Speed Grade
-2 -1
30,000,000
30,000,000
-1L
Units
Read
Cycles
Read
operations. Unaffected by SHIFT operations.
Cycles
DS152 (v3.6) March 18, 2014
Product Specification
www.xilinx.com
10
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